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n位DAC最大的输出电压uOmax为（ A）UD。
答案是：(2n – 1)
N变量的卡诺图中任一最小项应当有（B ）相邻块。
答案是：N
FPGA比较适合用在以（ C）的数字系统。
答案是：时序为主
DAC单位量化电压的大小等于Dn为（A ） 时，DAC输出的模拟电压值。
答案是：1
842BCD码0000表示的十进制数是（ C）。
答案是：87
74LS38有（B ）个译码输入端。
答案是：3
555构成的多谐振荡器中，还可通过改变（C ）端电压值使振荡周期改变。
答案是：C-U
555构成的多谐振荡器电路中，当R=R2时，欲使输出占空比约为50%，最简单的办法是（B ）。
答案是：R2两端并接二极管
0-4线优先编码器允许同时输入（ D）路编码信号。
答案是：多
“与非”逻辑运算结果为“0”的条件是该与项的变量（B ）。
答案是：全部输入“1”
“或非”逻辑运算结果为“0”的条件是该或项的变量（C ）。
答案是：至少有一个输入“1”
(95)H表示（D ）。
答案是：十六进制数
主从RS触发器在CP=1期间，R、S之间不存在约束。
答案是：错误
主从JK触发器在CP=1期间，存在一次性变化。
答案是：正确
正“与非”门也就是负“或非”门。
答案是：正确
在时间和幅度上都断续变化的信号是数字信号，语音信号不是数字信号。
答案是：正确
约束项就是逻辑函数中不允许出现的变量取值组合，用卡诺图化简时，可将约束项当作1，也可当作 0。
答案是：正确
优先编码器只对同时输入的信号中的优先级别最高的一个信号编码。
答案是：正确
因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。
答案是：错误
译码器哪个输出信号有效取决于译码器的地址输入信号。
答案是：正确
已知逻辑AB=AC，则B=C。
答案是：错误
已知逻辑A+B=A+C，则B=C。
答案是：错误
一个RAM有10根地址线，有4根数据线，存储容量是4K×4。
答案是：错误
一个N位逐次逼近型A/D转换器完成一次转换要进行N次比较，需要N+2个时钟脉冲。
答案是：正确
五进制计数器的有效状态为五个。
答案是：正确
为实现将JK触发器转换为D触发器，应使J=D,K=D。
答案是：正确
所有的触发器都存在空翻现象。
答案是：错误
数字电路中，化简逻辑函数的目的是为了所设计的逻辑电路更简单，更经济，而且其功能不变。
答案是：正确
时序电路不含有记忆功能的器件。
答案是：错误
施密特触发器有两个稳态。
答案是：正确
施密特触发器的特点是电路具有两个稳态且每个稳态需要相应的输入条件维持。
答案是：正确
三态门输出为高阻时，其输出线上电压为高电平
答案是：错误
三极管作为开关使用时，要提高开关速度，可降低饱和深度。
答案是：正确
若DAC的最大输出电压是10V，能分辨的最小输出电压是10mV，则该转换器输入数字的位数至少为10。
答案是：正确
如果与非门输入端均为高电平，那么它所带的是拉电流负载 。
答案是：错误
前进位加法器比串行进位加法器速度慢。
答案是：错误
模拟量送入数字电路前，须经A/D转换。
答案是：正确
逻辑变量的取值，1比0大。
答案是：错误
两个二进制数相加，并加上来自高位的进位，称为全加，所用的电路为全加器
答案是：错误
利用反馈归零法获得N进制计数器时，若为异步置零方式，则状态SN只是短暂的过渡状态，不能稳定而是立刻变为0状态。
答案是：正确
利用反馈归零法获得N进制计数器时，若为异步置零方式，则状态SN
答案是：正确
计数器可作分频器。
答案是：正确
计数器除了能对输入脉冲进行计数，还能作为分频器用。
答案是：正确
函数F连续取100次对偶，F不变。
答案是：正确
构成一个7进制计数器需要3个触发器。
答案是：正确
二进制数1001和二进制代码1001都表示十进制数。
答案是：错误
多谐振荡器有两个稳态。
答案是：错误
多谐振荡器常作为脉冲信号源使用。
答案是：正确
多个三态门的输出端相连于一总线上，使用时须只让一个三态门传送信号，其他门处于高阻状态。
答案是：正确
电路中可以实现“线与”功能的是三态输出门。
答案是：错误
当输入9个信号时，需要3位的二进制代码输出。
答案是：错误
当时序逻辑电路存在无效循环时该电路不能自启动
答案是：正确
单稳态触发器它有一个稳态和一个暂稳态。
答案是：正确
触发器中，存在连续空翻现象的有钟控的触发器。
答案是：正确
触发器的输出状态完全由输入信号决定。
答案是：错误
八位二进制数可以表示256种不同状态。
答案是：正确
八路数据分配器的地址输入（选择控制）端有8个。
答案是：错误
TTL与非门与CMOS与非门的逻辑功能不一样。
答案是：错误
RS触发器、JK触发器均具有状态翻转功能
答案是：错误
D/A转换器是将模拟量转换成数字量。
答案是：错误
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