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本题添加时间：2023/4/3 12:59:00
圆梦客服：王老师  19139051760(微信同号)  19139051760(微信同号)
[论述题,10分] 下面程序描述了一个数据选择器 MUX ，试补充完整。 空（ 1） mux(data_in1 ，data_in2，sel，data_out); input data_in1，data_in2; input [1 ：0] sel; output data_out; always @ （空（ 2）） begin case（空（ 3）） 2′ b00 ： data_out <= data_in1 ^ data_in2; 2′ b01： data_out <= data_in1 | data_in2; 2′ b10： data_out <= data_in1 ~^ data_in2; 2′ b11： data_out <= ~data_in1; 空（ 4）： data_out <=2 ′bxx； endcase end 空（ 5）

答案是:module |data_in1 ，data_in2，sel|sel|default|endmodule


出自 河南理工大学FPGA 原理与应用  联大系统

河南理工大学

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